A.輸出電壓
B.上限閥值電壓
C.下限閥值電壓
D.回差電壓
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A.脈沖周期
B.脈沖幅度
C.脈沖寬度
D.上升、下降時(shí)間
A.施密特觸發(fā)器
B.單穩(wěn)態(tài)觸發(fā)器
C.多諧振蕩器
D.555定時(shí)器
A.由門電路構(gòu)成的多諧振蕩器
B.石英晶體多諧振蕩器
C.555集成電路構(gòu)成的多諧振蕩器
D.由觸發(fā)器構(gòu)成的多諧振蕩器
A.輸出信號(hào)與輸入信號(hào)異步
B.各觸發(fā)器翻轉(zhuǎn)異步
C.輸入信號(hào)與時(shí)鐘脈沖異步
D.預(yù)置數(shù)控制與時(shí)鐘信號(hào)異步
A.雙拍接收寄存器存前要清零，單拍不必
B.單拍接收寄存器存前要清零，雙拍不必
C.兩者都必須清零
D.兩者都不必清零
最新試題
判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個(gè)（）。
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)，要求輸入每變化20mV，輸出信號(hào)的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
若停電數(shù)分鐘后恢復(fù)供電，（）中的信息能夠保持不變。
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是（）。
一個(gè)兩輸入端的門電路，當(dāng)輸入為10時(shí)，輸出不是1的門電路為（）
ROM可以用來存儲(chǔ)程序、表格和大量固定數(shù)據(jù)，但它不可以用來實(shí)現(xiàn)（）。
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對(duì)轉(zhuǎn)換精度的影響。
以下哪個(gè)編碼不能是二－十進(jìn)制譯碼器的輸入編碼（）