A.輸入低電平時(shí),三極管工作在截止區(qū),輸出為高電平。
B.輸入高電平時(shí),三極管工作在飽和區(qū),輸出為低電平。
C.輸入低電平時(shí),三極管工作在截止區(qū),輸出為低電平。
D.輸入高電平時(shí),三極管工作在飽和區(qū),輸出為高電平。
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A.電阻
B.電位器
C.二極管
D.三極管
A.晶體二極管
B.晶體三極管
C.MOS晶體管
D.晶體振蕩器
A.接高于2V的電壓
B.接另一TTL電路的輸出高電平
C.接地
D.懸空
A.接地
B.接低于0.8V的電壓
C.接另一個(gè)TTL電路的輸出
D.懸空
A.放大區(qū)
B.飽和區(qū)
C.截止區(qū)
D.發(fā)射區(qū)
最新試題
以下代碼中為無權(quán)碼的為()。
具有“有1出0、全0出1”功能的邏輯門是()
根據(jù)什么判斷簡(jiǎn)單電路中的險(xiǎn)象存在?
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù),需要增加若干個(gè)()。
雙積分型數(shù)字電壓表是否需要取樣-保持電路?請(qǐng)說明理由。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案,比較各種方案的特點(diǎn)。如果用HDPLD來實(shí)現(xiàn),設(shè)計(jì)方案是最佳嗎?簡(jiǎn)述理由。
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為()
10-4線優(yōu)先編碼器允許同時(shí)輸入()路編碼信號(hào)。
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是()。
與倒T形電阻網(wǎng)絡(luò)DAC相比,權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了()對(duì)轉(zhuǎn)換精度的影響。