單項(xiàng)選擇題在函數(shù)F=AB+CD的真值表中,F(xiàn)=1的狀態(tài)共有()個(gè)。
A.2
B.4
C.7
D.16
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1.單項(xiàng)選擇題2005個(gè)1連續(xù)異或的結(jié)果是()。
A.o
B.1
C.不唯一
D.邏輯概念錯(cuò)誤
2.單項(xiàng)選擇題兩個(gè)開(kāi)關(guān)控制一盞燈,只有兩個(gè)開(kāi)關(guān)都閉合時(shí)燈才不亮,則該電路的邏輯關(guān)系是()。
A.與非
B.或非
C.同或
D.異或
3.單項(xiàng)選擇題格雷碼的優(yōu)點(diǎn)是()。
A.代碼短
B.記憶方便
C.兩組相鄰代碼之間只有一位不同
D.同時(shí)具備以上三者
4.單項(xiàng)選擇題最常用的BCD碼是()。
A.5421碼
B.8421碼
C.余3碼
D.循環(huán)碼
5.單項(xiàng)選擇題用不同數(shù)制的數(shù)字來(lái)表示2005,位數(shù)最少的是()。
A.二進(jìn)制
B.八進(jìn)制
C.十進(jìn)制
D.十六進(jìn)制
最新試題
以下哪個(gè)編碼不能是二-十進(jìn)制譯碼器的輸入編碼()
題型:?jiǎn)雾?xiàng)選擇題
兩個(gè)與非門(mén)構(gòu)成的基本RS觸發(fā)器,當(dāng)Q=1、Q=0時(shí),兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)()。
題型:?jiǎn)雾?xiàng)選擇題
要使JK觸發(fā)器的輸出Q從1就成0,它的輸入信號(hào)JK就為()。
題型:?jiǎn)雾?xiàng)選擇題
10-4線優(yōu)先編碼器允許同時(shí)輸入()路編碼信號(hào)。
題型:?jiǎn)雾?xiàng)選擇題
雙積分型數(shù)字電壓表是否需要取樣-保持電路?請(qǐng)說(shuō)明理由。
題型:?jiǎn)柎痤}
若停電數(shù)分鐘后恢復(fù)供電,()中的信息能夠保持不變。
題型:?jiǎn)雾?xiàng)選擇題
具有“有1出0、全0出1”功能的邏輯門(mén)是()
題型:?jiǎn)雾?xiàng)選擇題
TTL與非門(mén)輸出高電平的參數(shù)規(guī)范值是()
題型:?jiǎn)雾?xiàng)選擇題
基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài),所以它不能被稱(chēng)為()觸發(fā)器。
題型:?jiǎn)雾?xiàng)選擇題
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體?是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體?簡(jiǎn)述它們的作用。
題型:?jiǎn)柎痤}