單項選擇題基本RS觸發(fā)器完成狀態(tài)轉換所需的時間為()觸發(fā)器。

A.tpd
B.2tpd
C.4tpd
D.6tpd


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2.單項選擇題觸發(fā)器和門電路()

A.二者都是時序邏輯電路
B.二者都無記憶功能
C.二者都有記憶功能
D.前者是時序邏輯電路

3.單項選擇題編碼器,譯碼器為()

A.組合邏輯電路
B.時序邏輯電路
C.脈沖電路
D.基本邏輯門電路

4.單項選擇題按觸發(fā)器的CP所決定的狀態(tài)轉換區(qū)分,計數(shù)器可分為()計數(shù)器。

A.加法、減法
B.同步和異步
C.二、十和N進制
D.可逆

5.單項選擇題T觸發(fā)器的邏輯功能是()

A.置0、置1
B.置0、置1、保持
C.置0、置1、保持、翻轉
D.保持、翻轉

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?CG放大器的性能描述合理的是()。

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?verilog語法中,間隔符號主要包括()。

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現(xiàn)在定義了一個1位的加法器addbit(ci,a,b,co,sum),模塊的結果用表達式表示為{co,sub}=a+b+ci,其中a,b為兩個加數(shù),ci為來自低位的進位,sum為和,co為向高位的進位,如果以此1位加法器構建四位加法器,同時定義頂層模塊中的端口信號和中間變量的定義:下面通過層次調(diào)用的方式進行邏輯實現(xiàn)中的表達式正確的是()。

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?verilogHDL的基本結構中通常需要進行模塊范圍的定義,VerilogHDL的模塊范圍的定義的開始和結束方式是()。

題型:單項選擇題