A.0000H~FFFFH
B.00000H~0FFFFH
C.00000000000000000000B~11111111111111111111B
D.0000000000000000B~1111111111111111B
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A.TF，DF
B.IF，TF
C.IF，DF
D.TF，ZF
A.每個(gè)段都是獨(dú)立尋址的邏輯單元，用于存放程序和數(shù)據(jù)
B.每個(gè)段的最大限制為64KB
C.每一個(gè)邏輯段的段內(nèi)地址位數(shù)為16位
D.一個(gè)存儲(chǔ)單元除具有一個(gè)唯一的物理地址外，還具有唯一對(duì)應(yīng)的邏輯地址
A.1234H
B.3456H
C.5634H
D.3412H
A.0
B.1
C.8
D.16
A.管理8086與系統(tǒng)總線的接口
B.負(fù)責(zé)CPU對(duì)存儲(chǔ)器和外設(shè)進(jìn)行訪問
C.負(fù)責(zé)指令的譯碼、執(zhí)行和數(shù)據(jù)的運(yùn)算
D.負(fù)責(zé)存儲(chǔ)數(shù)據(jù)
最新試題
CMP功能和SUB一樣，都是做減法，結(jié)果送目標(biāo)操作數(shù)。
對(duì)內(nèi)存和I/O端口統(tǒng)一編址時(shí)，系統(tǒng)中只有一個(gè)統(tǒng)一的地址空間。
全譯碼的優(yōu)點(diǎn)是每個(gè)芯片的地址范圍是唯一確定，而且各片之間是連續(xù)的，譯碼電路比較簡單。
（）主要用于將二進(jìn)制數(shù)的某些位求反。
下列各項(xiàng)可作為中斷源的是（）。
菊花鏈優(yōu)先級(jí)排隊(duì)電路是一種優(yōu)先級(jí)管理的簡單硬件方案。
CPU和輸入輸出設(shè)備之間的狀態(tài)信號(hào)是為了保證數(shù)據(jù)傳輸?shù)恼_性。
在8086系統(tǒng)中，一條指令最少以（）個(gè)字節(jié)的代碼形式存在于存儲(chǔ)器的碼段中。
對(duì)于嵌入式或用戶自己做的應(yīng)用系統(tǒng)，可根據(jù)實(shí)際需要來設(shè)計(jì)存儲(chǔ)器的容量。
執(zhí)行PUSH/POP指令時(shí)，段基址由（）提供。