A.各通道最大流量的最大值
B.各通道最大流量之和
C.各通道實(shí)際流量的最大值
D.各通道實(shí)際流量之和
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A.字節(jié)多路通道或選擇通道
B.字節(jié)多路通道或數(shù)組多路通道
C.選擇通道或數(shù)組多路通道
D.任意一種通道
A.訪管中斷
B.I/O中斷
C.程序性中斷
D.外部中斷
A.程序控制輸入輸出方式
B.中斷輸入輸出方式
C.直接存儲(chǔ)器訪問(wèn)方式
D.上述3種方式
A.增加cache中的塊數(shù)
B.增大組的大小
C.增大主存容量
D.增大塊的大小
A.同一條指令的讀操作與寫操作之間的寫后讀沖突。
B.先流入的指令的寫操作與后流入的指令的讀操作之間的寫后讀沖突
C.后流入的指令的寫操作與先流入的指令的讀操作之間的讀后寫沖突
D.兩條指令的寫操作之間的寫后寫沖突
最新試題
有一個(gè)16KB4路組相聯(lián)Cache的32位微處理器,假定該Cache的塊為4個(gè)32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
僅根據(jù)使用頻度,不考慮其它要求,設(shè)計(jì)出全Huffman操作碼,計(jì)算其平均碼長(zhǎng)。
為了使存儲(chǔ)系統(tǒng)的訪問(wèn)效率達(dá)到0.94,命中率和等效訪問(wèn)周期應(yīng)該提高到多少?
至少要分配給該程序多少個(gè)主存頁(yè)面才能獲得最高的命中率?
若采用LRU替換算法,計(jì)算Cache的塊命中率。
浮點(diǎn)數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進(jìn)制位數(shù)來(lái)說(shuō),等價(jià)于p=4。計(jì)算在非負(fù)階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個(gè)數(shù)。
如果一條指令的執(zhí)行過(guò)程分解為“取指令”和“分析”兩個(gè)階段,并采用兩級(jí)流水線。為了采用指令取消技術(shù),請(qǐng)修改上面的程序。
寫出主存地址和Cache地址的格式,并標(biāo)出各字段的長(zhǎng)度。
指出主存與Cache之間各個(gè)塊的映象關(guān)系。
在有16個(gè)處理器的均勻洗牌網(wǎng)絡(luò)中,若要使第0號(hào)處理器與第15號(hào)處理器相連,需要經(jīng)過(guò)多少次均勻洗牌和交換置換。