A.1腳
B.3腳
C.5腳
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A.4腳
B.8腳
C.1腳
D.6腳
A.集成555時(shí)基電路只用做定時(shí)器
B.集成555電路只能用于部分控制電路，如調(diào)光；調(diào)溫；調(diào)速等
C.集成555電路只能用于作多諧震蕩器
D.集成555電路工作可靠，使用方便；價(jià)格廉價(jià)；所以廣泛應(yīng)用
A.一個(gè)單穩(wěn)態(tài)電路
B.一個(gè)無(wú)穩(wěn)態(tài)電路
C.一個(gè)雙穩(wěn)態(tài)電路
D.一個(gè)帶放電開(kāi)關(guān)的RS觸發(fā)器
最新試題
?在verilogHDL的數(shù)字表達(dá)方式用，和十進(jìn)制數(shù)127表示的數(shù)字相同的表達(dá)方式有（）。
?在使用verilog描述一個(gè)二選一的數(shù)據(jù)選擇器時(shí)，使用一條語(yǔ)句來(lái)進(jìn)行描述assign out1=（sel &b）∣（~sel &a），這條語(yǔ)句對(duì)應(yīng)的是（）。
?verilog語(yǔ)法中，間隔符號(hào)主要包括（）。
?CS、CG和CD三種組態(tài)中，最適合做電壓放大器的還是CS放大器。
?5.1K±5%歐姆的五環(huán)電阻的色環(huán)序列為（）。
?數(shù)字頻率計(jì)設(shè)計(jì)中的測(cè)頻計(jì)數(shù)模塊共有多少個(gè)狀態(tài)？（）
?verilogHDL中已經(jīng)預(yù)先定義了的門(mén)級(jí)原型的符號(hào)有（）。
用作電壓放大器時(shí)，CS放大器不合適的參數(shù)為（）。?
?6位7段數(shù)碼管動(dòng)態(tài)顯示模塊如圖，要求人眼看到所有數(shù)碼管同時(shí)顯示各自對(duì)應(yīng)的數(shù)字，控制數(shù)碼管位選信號(hào)的動(dòng)態(tài)掃描時(shí)鐘信號(hào)頻率約為多少？（）
?MOSFET源極漏極間的長(zhǎng)度L越大，溝道長(zhǎng)度調(diào)制效應(yīng)越明顯。???